CDD - Ingénieur Design analogique FinFET H/F, Grenoble
CDD - Ingénieur Design analogique FinFET H/F, Grenoble
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Grenoble, France -
Publiée: il y a moins d’un mois
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Description
Objectif du poste Ce poste a pour objectif d’accompagner le développement de notre activité de conception de démonstrateurs technologiques FinFET sur les technologies avancées du LETI (mémoires non volatiles, circuits 3D).
Responsabilités
Évaluer les technologies fondeurs pour l’intégration des technologies LETI : FinFET / CMOS avancé (simulation électrique, étude du DRM, contribution à la mise en place de l’environnement de conception).
Contribuerà la conception de démonstrateurs technologiques (simulation électrique, layout, vérifications DRC, LVS, simulation post‑extraction de parasites).
Participer auxétudes de benchmark pour positionner les technologies du LETI à l’état de l’art.
Valoriser les travauxà travers la publication de papiers scientifiques et/ou le dépôt de brevets dans les domaines innovants.
Compétences attendues
Maîtrise des technologies FinFET, CMOS avancé.
Maîtrise de l’environnement de conception Cadence Virtuoso (schematic, symbol, layout, ADE).
Maîtrise d’au moins un simulateur parmi Eldo, Spectre ou Hspice (options, fonctionnement, limites).
Connaissance des simulateurs de type Fast‑Spice tels que Synopsys PrimeSim‑XA ou Cadence Spectre‑X.
Bonne connaissance des outils de vérification Calibre (DRC, LVS).
Bonne connaissance des outils d’extraction de parasites comme Synopsys Star‑RCXT, Calibre PEX, Cadence Quantus.
Profil du candidat Au-delà des compétences techniques, ce poste requiert plusieurs qualités humaines telles qu’autonomie, curiosité, rigueur, esprit d’équipe. De formation BAC+5, vous avez une expérience confirmée (de 5 à 10 ans) en conception de circuits intégrés ainsi que des connaissances pour les technologies micro‑nanoélectroniques.
Environnement de travail et avantages
Des formations pour renforcer vos compétences ou en acquérir de nouvelles.
Unéquilibre vie privée – vie professionnelle reconnu.
Un poste au cœur de la métropole grenobloise, facilement accessible via la mobilité douce favorisée par le CEA.
Une rémunération selon vos diplômes et votre expérience.
Un CSE actif en termes de loisirs et d’activités extra‑professionnelles.
Uneépargne abondée par le CEA.
Égalité et inclusion Conformément aux engagements pris par le CEA en faveur de l’intégration des personnes en situation de handicap, cet emploi est ouvert à toutes et à tous. Le CEA propose des aménagements et/ou des possibilités d’organisation, rejoignez‑nous!
Localisation Grenoble, France, Auvergne‑Rhone‑Alpes, Isère (38)
Informations supplémentaires Formation recommandée : Ingénieur, Master.
Disponibilité du poste : 02/03/2026.
#J-18808-Ljbffr
Responsabilités
Évaluer les technologies fondeurs pour l’intégration des technologies LETI : FinFET / CMOS avancé (simulation électrique, étude du DRM, contribution à la mise en place de l’environnement de conception).
Contribuerà la conception de démonstrateurs technologiques (simulation électrique, layout, vérifications DRC, LVS, simulation post‑extraction de parasites).
Participer auxétudes de benchmark pour positionner les technologies du LETI à l’état de l’art.
Valoriser les travauxà travers la publication de papiers scientifiques et/ou le dépôt de brevets dans les domaines innovants.
Compétences attendues
Maîtrise des technologies FinFET, CMOS avancé.
Maîtrise de l’environnement de conception Cadence Virtuoso (schematic, symbol, layout, ADE).
Maîtrise d’au moins un simulateur parmi Eldo, Spectre ou Hspice (options, fonctionnement, limites).
Connaissance des simulateurs de type Fast‑Spice tels que Synopsys PrimeSim‑XA ou Cadence Spectre‑X.
Bonne connaissance des outils de vérification Calibre (DRC, LVS).
Bonne connaissance des outils d’extraction de parasites comme Synopsys Star‑RCXT, Calibre PEX, Cadence Quantus.
Profil du candidat Au-delà des compétences techniques, ce poste requiert plusieurs qualités humaines telles qu’autonomie, curiosité, rigueur, esprit d’équipe. De formation BAC+5, vous avez une expérience confirmée (de 5 à 10 ans) en conception de circuits intégrés ainsi que des connaissances pour les technologies micro‑nanoélectroniques.
Environnement de travail et avantages
Des formations pour renforcer vos compétences ou en acquérir de nouvelles.
Unéquilibre vie privée – vie professionnelle reconnu.
Un poste au cœur de la métropole grenobloise, facilement accessible via la mobilité douce favorisée par le CEA.
Une rémunération selon vos diplômes et votre expérience.
Un CSE actif en termes de loisirs et d’activités extra‑professionnelles.
Uneépargne abondée par le CEA.
Égalité et inclusion Conformément aux engagements pris par le CEA en faveur de l’intégration des personnes en situation de handicap, cet emploi est ouvert à toutes et à tous. Le CEA propose des aménagements et/ou des possibilités d’organisation, rejoignez‑nous!
Localisation Grenoble, France, Auvergne‑Rhone‑Alpes, Isère (38)
Informations supplémentaires Formation recommandée : Ingénieur, Master.
Disponibilité du poste : 02/03/2026.
#J-18808-Ljbffr
Informations clefs
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Nom de l’entrepriseCEA -
Titre de posteCDD - Ingénieur Design analogique FinFET H/F
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